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产品概况
AD9554 是一款低环路带宽时钟转化器，可针对包含同步光纤网络(SONET/SDH)的许多体系供给颤动铲除和同步功用。 AD9554发生的输出时钟能够与多达四路外部输入参阅时钟同步。 数字PLL(DPLL)能够下降与外部参阅时钟相关的输入时刻颤动或相位噪声。 凭借数字操控环路和坚持电路，即便一切参阅输入都失效，AD9554也能继续发生低颤动输出时钟。
AD9554的工作温度规模为−40°C至+85°C工业温度规模。假如需求该器材的单或双DPLL版别，请别离参阅AD9557或AD9559。
使用
- 网络同步，包含同步以太网和同步数字体系(SDH)至光纤传输网络(OTN)映射/解映射
- 铲除基准时钟颤动
- 最高到达OC-192的SONET/SDH时钟，包含FEC
- Stratum 3坚持、颤动铲除及相位瞬态操控
- 有线基础设施
- 数据通信
优势和特色
- 在坚持形式下稳定性支撑GR-1244 Stratum 3
- 支撑平稳的参阅切换，简直不会搅扰输出相位
- 支撑Telcordia GR-253颤动发生、转化和容差，适用于SONET/SDH至OC-192体系
- 支撑ITU-T G.8262同步以太网从时钟
- 支撑ITU-T G.823、ITU-T G.824、ITU-T G.825和ITU-T G.8261
- 主动/手动坚持和参阅切换
- 自适应时钟可动态调整反应分频器，用于OTN映射/解映射使用
- 四通道数字锁相环(DPLL)架构，带四个基准输入电压（单端或差分）
- 4×4交叉点答应恣意基准输入驱动恣意PLL
- 输入参阅频率规模：2 kHz至1000 MHz
参阅验证和频率监控：2 ppm - 可编程设置输入参阅的切换优先级
20位可编程输入参阅分频器 - 8路差分时钟输出，每个差分对均可装备为HCSL、LVDS兼容或LVPECL兼容
- 输出频率规模：430 kHz至941 MHz
- 数字PLL集成可编程18位整数和24位小数反应分频器
- 可编程环路带宽：0.1 Hz至4 kHz
- 可选片外EEPROM存储上电Profile
- 72引脚(10 mm x 10 mm) LFCSP封装
AD9554电路图
AD9554中文PDF下载地址
AD9554下载链接地址：https://www.analog.com/media/en/technical-documentation/data-sheets/AD9554.pdf
