适用于多标准收发器中的可重构流水线ADC的应用设计-运算放大器是采样保持电路的核心，其性能直接影响采样保持电路的速度和精度，是流水线ADC电路设计的关键。本设计采用共源共栅两级运算放大器［4］，其第一级采用高速的套筒式共源共栅运算放大器来弥补两级运算放大器速度慢的缺点，因此整个电路具有相对较高的增益、较高的速度、较低的功耗和噪声及较大的输出摆幅等特点，其电路结构如图3所示。