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小梅哥和你一同深化学习FPGA之数码钟(上)

一、 实验目的实现数码时钟的功能,要求能够进行24时制时、分、秒的显示,并能够通过按键调整时间。二、 实验原理通过对系统时钟进行计数,获得1S的标准信号,再以该信号为基础,

  一、 试验意图

  完成数码时钟的功用,要求能够进行24时制时、分、秒的显现,并能够经过按键调整时刻。

  二、 试验原理

  经过对体系时钟进行计数,取得1S的规范信号,再以该信号为根底,进行时、分、秒的计数,经过数码管将该计数值显现出来,即可完成数字钟的功用。一起能够运用独立按键对时、分、秒计数器的初始值进行设置,即可完成时刻的设定。

  三、 硬件规划

  本试验硬件电路简略,用到了8个数码管和4个独立按键。硬件电路如下:

  

 

  图3-1 数字钟电路

  四、 架构规划

  本试验规划架构模块较多,下图为数字钟的架构:

  

 

  图4-1 数字钟试验模块安排结构图

  由图可知本试验有16个输出端口和6个输入端口,各端口的含义如下

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